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      ic前端崗位職責(zé)(2篇范文)

      發(fā)布時(shí)間:2023-06-04 11:30:03 查看人數(shù):48

      ic前端崗位職責(zé)

      第1篇 ic前端崗位職責(zé)

      ic前端 1、參與整個(gè)后端設(shè)計(jì)的流程,包括floorplan/placement/cts/routing/physical verification;

      2、與前端工程師協(xié)作完成block級(jí)別和全芯片級(jí)別的時(shí)序收斂;

      3、開發(fā)和優(yōu)化從前端至后端的物理設(shè)計(jì)流程;

      4、io ring設(shè)計(jì)/flipchip bump設(shè)計(jì);

      5、信號(hào)完整性以及電源完整性分析;

      任職條件

      1、對(duì)于時(shí)序分析和約束、功耗優(yōu)化、物理驗(yàn)證、電源完整性有較深入的理解;

      2、熟悉后端設(shè)計(jì)流程;

      3、熟悉先進(jìn)設(shè)計(jì)工藝;

      4、優(yōu)秀的腳本編寫能力。

      1、參與整個(gè)后端設(shè)計(jì)的流程,包括floorplan/placement/cts/routing/physical verification;

      2、與前端工程師協(xié)作完成block級(jí)別和全芯片級(jí)別的時(shí)序收斂;

      3、開發(fā)和優(yōu)化從前端至后端的物理設(shè)計(jì)流程;

      4、io ring設(shè)計(jì)/flipchip bump設(shè)計(jì);

      5、信號(hào)完整性以及電源完整性分析;

      任職條件

      1、對(duì)于時(shí)序分析和約束、功耗優(yōu)化、物理驗(yàn)證、電源完整性有較深入的理解;

      2、熟悉后端設(shè)計(jì)流程;

      3、熟悉先進(jìn)設(shè)計(jì)工藝;

      4、優(yōu)秀的腳本編寫能力。

      第2篇 數(shù)字ic前端崗位職責(zé)

      數(shù)字ic前端設(shè)計(jì) 主要職責(zé)

      1、負(fù)責(zé)數(shù)模混合ic中數(shù)字電路架構(gòu)選取、算法建模仿真、驗(yàn)證;

      2、獨(dú)立或帶領(lǐng)團(tuán)隊(duì)數(shù)字電路設(shè)計(jì)流程,包括rtl代碼編寫、驗(yàn)證、綜合、時(shí)序檢查。

      崗位要求:

      1.有2年以上數(shù)字ic前端工作經(jīng)驗(yàn);

      2.熟悉高速adc/dac、數(shù)字信號(hào)處理或jesd 204b控制電路;

      3.熟悉數(shù)字集成電路前端設(shè)計(jì)流程,熟悉verilog等硬件電路設(shè)計(jì)語言,熟悉數(shù)字邏輯電路設(shè)計(jì)的相應(yīng)eda。 15薪

      五險(xiǎn)一金,正常交按薪資

      每天工作8小時(shí),雙休,加班情況適度,不會(huì)過夜。

      蘇州 昆山市花橋鎮(zhèn)雙聯(lián)國際商務(wù)中心7幢6層

      上海 浦東新區(qū)晨暉路258號(hào)中興智慧園 主要職責(zé)

      1、負(fù)責(zé)數(shù)模混合ic中數(shù)字電路架構(gòu)選取、算法建模仿真、驗(yàn)證;

      2、獨(dú)立或帶領(lǐng)團(tuán)隊(duì)數(shù)字電路設(shè)計(jì)流程,包括rtl代碼編寫、驗(yàn)證、綜合、時(shí)序檢查。

      崗位要求:

      1.有2年以上數(shù)字ic前端工作經(jīng)驗(yàn);

      2.熟悉高速adc/dac、數(shù)字信號(hào)處理或jesd 204b控制電路;

      3.熟悉數(shù)字集成電路前端設(shè)計(jì)流程,熟悉verilog等硬件電路設(shè)計(jì)語言,熟悉數(shù)字邏輯電路設(shè)計(jì)的相應(yīng)eda。

      ic前端崗位職責(zé)(2篇范文)

      ic前端 1、參與整個(gè)后端設(shè)計(jì)的流程,包括floorplan/placement/cts/routing/physical verification;2、與前端工程師協(xié)作完成block級(jí)別和全芯片級(jí)別的時(shí)序收斂;3、開發(fā)和優(yōu)化…
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